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Progettazione VLSI di un coprocessore matematico per sistemi embedded

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Introduzione pag. IV Nell’Appendice C è riportato il codice VHDL che descrive l’interfaccia per connettere la FPU al LEON. Nell’appendice D è riportato lo Script utilizzato per fare la sintesi della FPU con il software di Synopsys. Nell’Appendice E è riportata la verifica del metodo di Newton-Raphson per il calcolo della radice quadrata dei numeri denormalizzati.

Anteprima della Tesi di Giorgio Filippi

Anteprima della tesi: Progettazione VLSI di un coprocessore matematico per sistemi embedded, Pagina 4

Tesi di Laurea

Facoltà: Ingegneria

Autore: Giorgio Filippi Contatta »

Composta da 218 pagine.

 

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