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Progettazione VLSI di un coprocessore matematico per sistemi embedded

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Capitolo 1 : Il Microprocessore LEON pag. 4 AMBA AHB: interconette il processor core (integer unit e i controllori della cache) al controllore della memoria, all’APB bridge e ad eventuali altre unità a cui sono richieste alte prestazioni. Il processore è l’unico master sul bus mentre ci sono due slave: il controllore della memoria e l’APB bridge. L’AMBA AHB è in grado di connettere fino a 16 unità master e un numero elevato di unità slave. AMBA APB: interconette l’AMBA AHB con le unità periferiche attraverso l’APB bridge. Le unità periferiche connesse all’APB sono: il controllore delle interruzioni, il timer, 2 unità uart e la I/O port. L’APB bridge è connesso all’AHB come unità slave, mentre è l’unica unità master per l’AMBA APB bus. 1.3.a Bus AHB Permette di realizzare trasferimenti dati ad alta velocità e consente: • trasferimenti burst; • transizioni split; • handover tra i master presenti sul bus in un unico ciclo; • operazioni su un unico fronte di clock; • implementazione non tristate; • trasferimenti dati fino a 128 bit. Tipicamente il sistema AMBA AHB è costituito da: • AHB master: il master è capace di iniziare un’operazione di lettura o scrittura fornendo un indirizzo e informazioni di controllo. Ad ogni istante un solo master è abilitato ad utilizzare il bus. (figura 1.3) • AHB slave: lo slave risponde ad un’operazione di lettura o scrittura effettuata in un dato range nello spazio di indirizzamento. Segnala al master attivo il successo, il fallimento o un’operazione di attesa (waiting) del trasferimento dati richiesto.(figura 1.4).
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Progettazione VLSI di un coprocessore matematico per sistemi embedded

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Informazioni tesi

  Autore: Giorgio Filippi
  Tipo: Tesi di Laurea
  Anno: 2003-04
  Università: Università degli Studi di Pisa
  Facoltà: Ingegneria
  Corso: Ingegneria Elettronica
  Relatore: Pirangelo Terreni
  Lingua: Italiano
  Num. pagine: 218

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Parole chiave

coprocesore matematico
fpu
sintesi logica
sistemi embedded
vhdl

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