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Trasferimento dati a 2.4 Gb/s in standard differenziale

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Capitolo 1 – Introduzione 2 zione in una struttura interna. La velocità del trasferimento è fissata a 2.4 Gb/s: la frequenza di cam- pionamento del MAX104 è infatti pari a 300 MHz e l’ampiezza dei campioni è di 8 bit (300 MHz x 8 bit = 2.4 Gb/s); poiché l’ADC trasferisce dati, con ampiezza doppia e frequenza dimezzata, in standard LVPECL (uno stan- dard differenziale di cui si dirà nel seguito), la V2MB1000 dovrà essere in grado di ricevere i 16 bit in parallelo a 150 MHz (dunque ancora a 2.4 Gb/s) in tale standard. Il lavoro consiste pertanto nel programmare opportunamente la FPGA secondo queste specifiche, e nel realizzare opportune interfacce per consen- tire il collegamento ottimale tra le due schede. 1.2 Struttura di questa documentazione 1.2.1 Capitolo 2 Il Capitolo 2 presenta una descrizione dettagliata di tutti i sistemi hardware utilizzati. In particolare, nel primo paragrafo si descrivono la FPGA Virtex-II, la relativa Development Board, il software utilizzato per programmarla, il convertitore A/D MAX104 e la relativa Evaluation Board. Il secondo paragrafo è dedicato alla descrizione degli standard differen- ziali, con particolare attenzione ai due utilizzati in questo lavoro (LVPECL e LVDS). Nel terzo paragrafo vengono descritti gli strumenti di misura: il main- frame Tektronix TLA721, gli oscilloscopi LeCroy WaveMaster 8600A e Te- ktronix TDS3032B e il multimetro digitale Fluke 187 True RMS.

Anteprima della Tesi di Stefano Infante

Anteprima della tesi: Trasferimento dati a 2.4 Gb/s in standard differenziale, Pagina 4

Tesi di Laurea

Facoltà: Ingegneria

Autore: Stefano Infante Contatta »

Composta da 196 pagine.

 

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Disponibile in PDF, la consultazione è esclusivamente in formato digitale.