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Progettazione di microprocessori asincroni per l'elaborazione numerica dei segnali

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12 l’utilizzo del risultato intermedio, per le nuove operazioni nella pipe, prima che sia terminata la fase di write-back nel registro destinazione (result forwarding). La prestazioni nella scrittura in memoria, punto dolente di ogni architettura, sono state aumentate introducendo un buffer che esegue velocemente l’operazione salvando temporaneamente il valore del dato prima di riversarlo autonomamente, in un secondo tempo, in memoria. Il numero degli stadi di pipe legati alle funzionalità espresse nelle unità, e quelle insite nei componenti della Data Alu sono state trasmesse al nuovo progetto come specifiche portanti della ricerca sviluppata nelle tesi precedenti. La codifica ridondante, pur avendo contribuito alla espansione dello spessore dei collegamenti interni (la codifica raddoppia la word dei dati e indirizzi), ha comunque permesso l’abbattimento del tempo medio d’esecuzione delle operazioni, sia nella Data Alu che nelle Address generation unit, orientando l’architettura alle applicazione in cui fosse marcata, sopra ogni altra, la specifica prestazionale. Specifiche aggiuntive Il progetto del DSP asincrono è stato sviluppato per venire incontro anche alle specifiche di consumo della macchina, e alla sua applicabilità su sistemi portatili che richiedono, in maniera determinante, il requisito della potenza assorbita. Nel lavoro svolto si è cercato, nei limiti del possibile, di mantenere un discreto livello di prestazioni ed una elevata compatibilità con la struttura delle unità importate dal progetto preso come punto di partenza. Riassumendo, le specifiche aggiuntive che si sono introdotte sono state le seguenti: - Modalità di comunicazione completamente asincrona per le unità e per le intime sezioni in cui ciascuna risulta divisa. - Versatilità ed espandibilità dell’architettura. - Mantenimento del livello delle prestazioni. - Basso consumo. L’assunzione delle specifiche di progetto aggiuntive, in particolare l’implementazione delle comunicazioni asincrone, hanno proiettato la progettazione dell’architettura e dei
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Progettazione di microprocessori asincroni per l'elaborazione numerica dei segnali

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Informazioni tesi

  Autore: Raul Ricci
  Tipo: Tesi di Laurea
  Anno: 2001-02
  Università: Università degli Studi di Roma La Sapienza
  Facoltà: Ingegneria
  Corso: Ingegneria Elettronica
  Relatore: Mauro Olivieri
  Lingua: Italiano
  Num. pagine: 196

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Parole chiave

asynchronous architecture
calcolo parallelo
control-path
controllo distribuito
data-path
delay insensitive
distributed control
dsp
macchina a stati
progetto asincrono

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