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Analisi delle architetture di microprocessori commerciali

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4 RAM (RDRAM) che ha consentito una banda di 1,6 GB/s con bus da 100 MHz sulla quale Intel ha puntato molto e l’affinamento di tecniche come la Double Data Rate SDRAM che hanno consentito anch’esse bande superiori al GB/s. Da registrare infine la comparsa del bus di nuova generazione EV6 che, implementando la topologia "Point to Point", ha consentito di collegare più processori senza suddividere la banda aprendo la strada ad una tendenza che potrebbe vedersi consolidata nei prossimi anni per un ulteriore salto nelle prestazioni. Altre innovazioni tecniche, non strettamente legate al processo realizzativo, che si annunciano assai significative sono state adottate da Intel con il Willamette come la ALU funzionante a frequenza doppia rispetto al processore o il bus a 400 MHz. Anche se i particolari tecnici di queste innovazioni non sono ancora perfettamente noti essi sembrano riferirsi ad uno sfruttamento di entrambi i fronti di salita dei segnali di clock. 1.1 Il parallelismo dei dati Gli algoritmi utilizzati nelle applicazioni multimedia e DSP (Digital Signal Processing) prevedono sostanzialmente l’applicazione della medesima operazione ad un grande numero di dati del medesimo tipo. Un tipico esempio può essere l’inversione di una immagine RGB per determinarne il negativo oppure la riproduzione del movimento in una scena 3D. Il modo migliore di trattare dati di tale natura consiste nel raggrupparne un certo numero all’interno di un vettore e operare su di esso piuttosto che operare sui singoli dati (un dato alla volta) per analogia definiti scalari. La tecnica che sottende a questo procedimento è conosciuta come SIMD ed è diventata una delle parole chiave dei processori di recente realizzazione che la applicano a dati floating point che sono i più coinvolti nelle applicazioni multimediali. A questa scelta, ancora una volta, sono giunti sia processori nativi CISC che RISC sebbene l’introduzione di nuove istruzioni e di nuove unità a livello hardware non appartenga certo al canone RISC. Le scelte che differenziano l’implementazione di tale tecnica riguardano essenzialmente l’introduzione di appositi registri o, analogamente a quanto fatto a suo tempo da Intel con la tecnologia MMX su interi, la condivisione di registri esistenti.
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Analisi delle architetture di microprocessori commerciali

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Informazioni tesi

  Autore: Francesco Moro
  Tipo: Laurea liv.II (specialistica)
  Anno: 2003-04
  Università: Università degli Studi di Roma La Sapienza
  Facoltà: Ingegneria elettronica
  Corso: Ingegneria elettronica
  Relatore: Mauro Olivieri
  Lingua: Italiano
  Num. pagine: 120

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Parole chiave

elettronica
microlettronica
processori

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